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    • vds是输出mos晶体管的漏极-源极间电压。对于漏极开路，是指输出nchmos的输出-gnd间电压。对于cmos输出，则是指nchmos输出-gnd间电压或pchmos输出-vdd间电压。
      • products: voltage detector with fixed delay time
      faq id: 2125
    • er端子是强制复位的输入。向er端子施加“h”以上的电压，复位输出将会变为“l”。详情请参考datasheet的“时序波形”。
      • faq id: 2114
    • 输入输出之间没有二极管。输出电容器会在电源电压下降使复位输出变为“l”，输出晶体管on时进行放电。datasheet记载的iol为放电电流能力。
      • products: voltage detector with fixed delay time
      faq id: 2082
    • 进行漏极开路输出时，vdd如果从低于检测电压，复位ic输出为“l”的状态，降至低于工作极限电压（vopl），输出nmos晶体管将会off，输出的是输出电阻的上拉目标电压。进行cmos输出时也是如此，vdd如果从输出“l”的状态降至低于vopl，nmos晶体管将会off，输出的是vdd附近的电压。如果vdd继续降至低于pmos晶体管的阈值，输出将会变为高阻抗，且变得不稳定。无论是漏极开路输出，还是cmos输出，vdd在0v～vopl附近时，输出会在vdd的拉动下上浮，如果稍许的上浮也会给系统造成问题，建议为输出连接电容器。上述情况会随应用发生变化，使用前请充分确认实际动作。
      • products: voltage detector with fixed delay time
      faq id: 2085
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